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ADC - Sample Time and Total Conversion Time

Titre du sujet : ADC - Sample Time and Total Conversion Time
par ikoria sur 06/06/2017 09:19:14

Bonjour à tous :)

Il ne me semble pas avoir vu de post sur le sujet.

Source d'informations: la Datasheet HCS08DZxx(§10.4.4.5) et le bouquin "HSC08 Unleashed".

La documentation n'est pas très claire et il me semble que l'exemple de la datasheet est erroné...

Citation :

For example, in 10-bit mode, with the bus clock selected as the input clock source, the input clock divide-by-1
ratio selected, and a bus frequency of 8 MHz, then the conversion time for a single conversion is:
(23 ADCK cycle / 8MHz) + (5 bus cycle / 8MHz) = 3.5ms


Pourriez-vous me confirmer que le résultat devrait être: 0.000002875 + 0.000000625 = 0.0000035, soit 3.5µs?
Pourriez-vous me confirmer que ceci inclus le sampling time (3.5 ou 23.5 ADCK cycle)?

Un autre exemple:
Bus clock 16MHz
Diviseur par 8
long sampling time
High speed mode
single, 12bits conversion

Si j'en croie la datasheet (Table 10-13), Max total conversion time = 43 ADCK cycles + 5 bus clock cycles, soit 22.125µs.
Est-ce correct?

Merci d'avance pour vos lumières :)
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